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synced 2025-12-22 17:30:17 +03:00
t23x: overlay: remove tegra234-p3768-0000+p3767-0005 again
The file tegra234-p3768-0000+p3767-0005 was previously removed and
was mistakenly added back in another patch.
Bug 4204734
Bug 4191790
Fixes: 35cf164bfb ("orin-nx: configure camera sensor using jetson-io")
Change-Id: I0201567f7b9f8b2f2d85b966ddbfb2df8b47396c
Signed-off-by: Brad Griffis <bgriffis@nvidia.com>
Reviewed-on: https://git-master.nvidia.com/r/c/device/hardware/nvidia/t23x-public-dts/+/2983864
Reviewed-by: Laxman Dewangan <ldewangan@nvidia.com>
GVS: Gerrit_Virtual_Submit <buildbot_gerritrpt@nvidia.com>
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8c6f5f04a9
@@ -1,225 +0,0 @@
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// SPDX-License-Identifier: GPL-2.0-only
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// Copyright (c) 2023, NVIDIA CORPORATION & AFFILIATES. All rights reserved.
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/dts-v1/;
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/plugin/;
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#include "tegra234-overlay.dtsi"
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#include "tegra234-soc-thermal.dtsi"
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#include "tegra234-soc-thermal-slowdown-corepair.dtsi"
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#include "tegra234-soc-thermal-shutdown.dtsi"
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#include "tegra234-p3767-0000.dtsi"
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#include "tegra234-soc-camera.dtsi"
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/ {
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overlay-name = "Tegra234 P3768-0000+P3767-0005 Overlay";
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fragment-t234-p3768-0000-p3767-0005@0 {
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target-path = "/";
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__overlay__ {
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bus@0 {
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pinmux@2430000 {
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status = "okay";
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};
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i2c@3180000 {
|
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||||||
status = "okay";
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};
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||||||
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/* UARTA, 40 pin header, Pin 8(TX), Pin 10(RX) */
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serial@3100000 {
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||||||
compatible = "nvidia,tegra194-hsuart";
|
|
||||||
status = "okay";
|
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||||||
};
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||||||
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||||||
/* UARTE, M2.E connector */
|
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||||||
serial@3140000 {
|
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||||||
compatible = "nvidia,tegra194-hsuart";
|
|
||||||
status = "okay";
|
|
||||||
};
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||||||
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||||||
/* SPI1, 40pin header, Pin 19(MOSI), Pin 21(MISO), Pin 23(CLK), Pin 24(CS) */
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spi@3210000{
|
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||||||
status = "okay";
|
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||||||
spi@0 {
|
|
||||||
compatible = "tegra-spidev";
|
|
||||||
reg = <0x0>;
|
|
||||||
spi-max-frequency = <50000000>;
|
|
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controller-data {
|
|
||||||
nvidia,enable-hw-based-cs;
|
|
||||||
nvidia,rx-clk-tap-delay = <0x10>;
|
|
||||||
nvidia,tx-clk-tap-delay = <0x0>;
|
|
||||||
};
|
|
||||||
};
|
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||||||
spi@1 {
|
|
||||||
compatible = "tegra-spidev";
|
|
||||||
reg = <0x1>;
|
|
||||||
spi-max-frequency = <50000000>;
|
|
||||||
controller-data {
|
|
||||||
nvidia,enable-hw-based-cs;
|
|
||||||
nvidia,rx-clk-tap-delay = <0x10>;
|
|
||||||
nvidia,tx-clk-tap-delay = <0x0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
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||||||
};
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||||||
/* SPI3, 40pin header, Pin 37(MOSI), Pin 22(MISO), Pin 13(CLK), Pin 18(CS) */
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||||||
spi@3230000{
|
|
||||||
status = "okay";
|
|
||||||
spi@0 {
|
|
||||||
compatible = "tegra-spidev";
|
|
||||||
reg = <0x0>;
|
|
||||||
spi-max-frequency = <50000000>;
|
|
||||||
controller-data {
|
|
||||||
nvidia,enable-hw-based-cs;
|
|
||||||
nvidia,rx-clk-tap-delay = <0x10>;
|
|
||||||
nvidia,tx-clk-tap-delay = <0x0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
spi@1 {
|
|
||||||
compatible = "tegra-spidev";
|
|
||||||
reg = <0x1>;
|
|
||||||
spi-max-frequency = <50000000>;
|
|
||||||
controller-data {
|
|
||||||
nvidia,enable-hw-based-cs;
|
|
||||||
nvidia,rx-clk-tap-delay = <0x10>;
|
|
||||||
nvidia,tx-clk-tap-delay = <0x0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
i2c@c240000 {
|
|
||||||
status = "okay";
|
|
||||||
ina32211_1_40: ina3221@40 {
|
|
||||||
compatible = "ti,ina3221";
|
|
||||||
reg = <0x40>;
|
|
||||||
#address-cells = <1>;
|
|
||||||
#size-cells = <0>;
|
|
||||||
#io-channel-cells = <1>;
|
|
||||||
channel@0 {
|
|
||||||
reg = <0x0>;
|
|
||||||
label = "VDD_IN";
|
|
||||||
shunt-resistor-micro-ohms = <5000>;
|
|
||||||
};
|
|
||||||
channel@1 {
|
|
||||||
reg = <0x1>;
|
|
||||||
label = "VDD_CPU_GPU_CV";
|
|
||||||
shunt-resistor-micro-ohms = <5000>;
|
|
||||||
};
|
|
||||||
channel@2 {
|
|
||||||
reg = <0x2>;
|
|
||||||
label = "VDD_SOC";
|
|
||||||
shunt-resistor-micro-ohms = <5000>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
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||||||
|
|
||||||
/* PWM1, 40pin header, pin 15 */
|
|
||||||
pwm@3280000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
/* PWM5, 40pin header, pin 33 */
|
|
||||||
pwm@32c0000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
/* PWM7, 40pin header, pin 32 */
|
|
||||||
pwm@32e0000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
tachometer@39c0000 {
|
|
||||||
status = "okay";
|
|
||||||
upper-threshold = <0xfffff>;
|
|
||||||
lower-threshold = <0x0>;
|
|
||||||
};
|
|
||||||
|
|
||||||
hsp@3d00000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
aon@c000000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
mttcan@c310000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
host1x@13e00000 {
|
|
||||||
nvdec@15480000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
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||||||
|
|
||||||
tegra_soc_hwpm {
|
|
||||||
status = "okay";
|
|
||||||
};
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|
||||||
};
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|
||||||
};
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||||||
|
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||||||
cpus {
|
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idle-states {
|
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||||||
c7 {
|
|
||||||
status = "okay";
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};
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|
||||||
};
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||||||
};
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||||||
nvpmodel {
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||||||
status = "okay";
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||||||
};
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||||||
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||||||
soctherm-oc-event {
|
|
||||||
status = "okay";
|
|
||||||
};
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||||||
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||||||
thermal-zones {
|
|
||||||
cpu-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
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||||||
gpu-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
|
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||||||
|
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||||||
cv0-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
|
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||||||
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||||||
cv1-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
|
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||||||
|
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||||||
cv2-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
|
|
||||||
soc0-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
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||||||
|
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||||||
soc1-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
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||||||
|
|
||||||
soc2-thermal {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
};
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||||||
tegra-hsp@b950000 {
|
|
||||||
status = "okay";
|
|
||||||
};
|
|
||||||
};
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|
||||||
};
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|
||||||
};
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||||||
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/*
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* Include this file last in the device tree. It manages run-time
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* pruning of peripherals that are not available across the various
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* SKUs of p3767. For example PVA can be enabled in the device tree
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* and it will automatically be disabled for SKUs without PVA support.
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*/
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#include "tegra234-p3767-sku-handling.dtsi"
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